5033787 core kingdom 1698156443
139
简易的RISC-V五级流水线标量处理器:CK_RISCV; 支持RV32I指令集,使用Veriog编写,简单易懂; 参照公司研发环境,设计一套规范的设计与验证环境;
Verilog
10个月前
12289796 wilson chen 1676527518
51
HDLGen是一个HDL/RTL生成工具,支持在Verilog里内嵌Perl或Python script来帮助快速、高效地生成期望的设计,支持Perl或者Python的所有数据结构和语法,有若干内嵌函数来提高效率,也支持扩展API,支持自动Instance、自动信号生成、IPXACT、JSON、XML、模板等输入来减少手动工作、提高开发效率、降低出错几率,大大提高IP开发和SOC集成的效率
Perl
6个月前
9096373 wangxuan95 1681793107
41
一篇全面的 Bluespec SystemVerilog (BSV) 中文教程,介绍了BSV的调度、FIFO数据流、多态等高级特性,展示了BSV相比于传统Verilog开发的优势。
8个月前
10948991 twelvenine 1652431103
16
三种哈希表的Verilog硬件实现结构
Verilog
接近2年前
9421900 pan xingyu 1637505672
15
顺序2发射RV64G核心
Verilog
21天前
9132807 middle class free heart 1646744556
12
Cortex-M0作为CPU的SoC工程样例,用于分享和学习。
12个月前
11
一个面向Windows的Verilog图形界面仿真工具
1年多前
5646269 bei yi ning 1579746558
7
基于MIPS32架构设计标量单核多周期五级流水处理器RoLa 项目原型:OpenMIPS
Verilog
1年多前
9004876 hmount 1652626390
5
基于Verilog HDL开发的RISCV-CPU,支持miniRV-1指令集的SoC设计, 支持能处理冲突的五级流水线RISCV-CPU和数码管、LED灯等外设.
Verilog
1年多前
9421900 pan xingyu 1637505672
4
This is a tiny soc with tiny 8bit cpu
Verilog
2年多前
4
用python写Verilog HDL
2年前
2195160 xuxiaokang 1667981588
3
Verilog功能模块
Verilog
4个月前
12261513 startfromc 1671936172
3
大二计算机组成原理课设,使用Verilog硬件描述语言实现MIPS处理器基本功能,包括MIPS单周期处理器、MIPS多周期处理器以及简单的中断设计
Verilog
8个月前
2
本项目为第一代100M练手交换机:仅支持简单数据转发功能,MII接口; 已全部完成,第一代仅支持最普通的数据交换功能 目前已开启第二代1000M交换机项目—Atom:支持多种市场化功能,与商业交换机更接近,功能更丰富 有需要的可以在gitee中搜索atom关注
Verilog
4个月前
10518735 whyima 1700566262
2
利用xdma ip 实现了pcie传输视频数据上传到pc,实现了qt显示视频数据
Verilog
4个月前

搜索帮助